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数字电子技术基础-(第2版) 版权信息
- ISBN：9787512419377
- 条形码：9787512419377 ; 978-7-5124-1937-7
- 装帧：一般胶版纸
- 册数：暂无
- 重量：暂无
- 所属分类：>>
数字电子技术基础-(第2版) 内容简介
《数字电子技术基础（第2版）/工业和信息化部“十二五”规划教材》是工信部“十二五”规划教材。这本教材凝聚了作者多年的教学积累和精华，内容新颖并且可读性强。同时《数字电子技术基础（第2版）/工业和信息化部“十二五”规划教材》坚持以“学”为中心的教学理念，每章提出探索问题，引导学生自主学习。 教材结构由问题探究、课程导论和主体内容3部分组成。全书共分7章，第1章逻辑代数基础，第2章门电路，第3章组合数字电路，第4章触发器和定时器，第5章时序数字电路，第6章大规模集成电路和第7章数模与模数转换器。书中还配有适量的习题、硬件描述语言和仿真实例。在可编程逻辑器件部分紧密与实验平台相结合阐述编程设计过程，设有附录VHDL语言结构和语法规则供学习者参考。 《数字电子技术基础（第2版）/工业和信息化部“十二五”规划教材》可作为普通高等工科学校和大中专院校的电子、电气和自控类专业的教材，也可供从事这方面工作的工程技术人员参考。
数字电子技术基础-(第2版) 目录
绪论
第1章 逻辑代数基础
1．1 导论
1．1．1 模拟信号与数字信号
1．1．2 二进制的算术运算
1．1．3 数制和码制
1．2 逻辑运算
1．2．1 基本逻辑运算
1．2．2 组合逻辑运算
1．3 公式和定理
1．3．1 常量与常量之间的关系
1．3．2 变量与常量之间的关系
1．3．3 特殊定理
1．3．4 与普通代数相似的定理
1．3．5 几个常用公式
1．4 基本规则
1．4．1 代入规则
1．4．2 对偶规则
1．4．3 反演规则
1．5 用代数法化简逻辑式
1．5．1 同一逻辑关系逻辑式形式的多样性
1．5．2 与或型逻辑式的化简步骤
1．6 *小项和*大项
1．6．1 *小项和*大项的定义
1．6．2 *小项和*大项的性质
1．6．3 与或标准型和或与标准型
1．7 卡诺图化简法
1．7．1 卡诺图
1．7．2 与项的读取和填写
1．7．3 卡诺图化简的原则
1．7．4 卡诺图化简的步骤
1．7．5 具有约束条件的逻辑函数化简
1．8 逻辑函数的变换
1．8．1 5种类型的逻辑函数
1．8．2 与或型转换为与非与非型
1．8．3 与或型转换为或与型
1．8．4 与或型转换为或非或非型
1．8．5 与或型转换为与或非型
1．9 逻辑式的*佳化
1．9．1 逻辑式*佳化的概念
1．9．2 异或门实现*佳化
1．9．3 实现*佳化的一般方法
习题
第2章 门电路
2．1 导论
2．1．1 半导体二极管的开关特性
2．1．2 半导体三极管的开关特性
2．2 分立元件门电路
2．2．1 与门
2．2．2 或门
2．2．3 非门（反相器）
2．3 集成门电路（TTL）
2．3．1 TTL与非门电路结构
2．3．2 电路的逻辑功能
2．3．3 特性曲线
2．3．4 参数与指标
2．4 其他类型TTL门
2．4．1 集电极开路门（OC门）
2．4．2 三态门
2．4．3 与或非门、或非门和异或门
2．4．4 TTL系列门标准参数
2．5 CMOS逻辑门
2．5．1 CMOS反相器
2．5．2 CMOS与非门电路
2．5．3 CMOS传输门
2．5．4 CMOS门的参数指标
2．6 数字电路的VHDL描述
2．6．1 与非门
2．6．2 或非门
2．6．3 异或门
习题
第3章 组合数字电路
3．1 导论
3．2 组合数字电路的分析
3．2．1 组合电路的分析方法
3．2．2 分析异或门
3．3 组合数字电路的设计
3．3．1 半加法器设计
3．3．2 全加器设计
3．3．3 全加器的VHDL描述
3．4 常用组合集成逻辑电路
3．4．1 集成4位超前进位全加器
3．4．2 译码器
第4章 触发器和定时器
4．1 导论
4．1．1 时序数字电路的定义
4．1．2 触发器的分类和逻辑功能
4．2 基本RS触发器
4．2．1 基本RS触发器的工作原理
4．2．2 2个稳态
4．2．3 触发翻转
4．2．4 真值表和特征方程
4．2．5 状态转换图
4．2．6 集成基本RS触发器
4．3 同步时钟RS触发器
4．3．1 同步时钟触发器引出
4．3．2 同步RS时钟触发器的结构和原理
4．3．3 同步RS时钟触发器的特征方程
4．3．4 波形及空翻现象
4．3．5 状态转换图
4．4 主从触发器
4．4．1 主从RS触发器
4．4．2 主从JK触发器
4．5 边沿触发器
4．5．1 维持阻塞D触发器的电路结构
4．5．2 维持阻塞D触发器的工作原理
4．5．3 特征表和特征方程
4．5．4 状态转换图和时序图
4．5．5 边沿集成D触发器
4．6 边沿JK触发器
4．6．1 边沿JK触发器的结构与原理
4．6．2 特征表和特征方程
4．6．3 状态转换图和时序图
4．6．4 逻辑符号
4．6．5 集成边沿JK触发器
4．7 触发器VHDL描述
4．7．1 程序设计
4．7．2 仿真验证
4．8 555定时器
4．8．1 概述
4．8．2 单稳态触发器
4．8．3 多谐振荡器
4．8．4 密特触发器
4．8．5 压控振荡器
习题
第5章 时序数字电路
5．1 导论
5．2 时序电路分析
5．2．1 同步电路分析
5．2．2 异步电路分析
5．3 同步时序数字电路的设计
5．3．1 同步计数器设计
5．3．2 时序逻辑问题设计
5．4 常用时序逻辑器件
5．4．1 寄存器和移位寄存器
5．4．2 计数器
5．4．3 用集成计数器实现任意进制计数器
5．4．4 用VHDL语言描述时序电路
习题
第6章 存储器及大规模集成电路
6．1 导论
6．2 只读存储器ROM
6．2．1 ROM的结构和工作原理
6．2．2 ROM的分类
6．2．3 ROM的应用
6．3 随机存储器
6．3．1 RAM的结构和原理
6．3．2 RAM的存储单元
6．3．3 集成RAM
6．4 可编程逻辑器件概述
6．4．1 PLD的发展
6．4．2 PLD的分类和特点
6．4．3 实现可编程的基本方法
6．5 通用阵列逻辑GAL
6．5．1 概述
6．5．2 GAL的结构
6．5．3 通用阵列逻辑GAL的编程
6．5．4 ispLSI器件的编程语言简介
6．5．5 数字小系统的设计及实现
6．6 现场可编程门阵列FPGA
6．6．1 FPGA的基本结构
6．6．2 FPGA的编程
习题
第7章 数模与模数转换器
7．1 导论
7．2 DA转换器
7．2．1 倒T型电阻解码网络DA转换器
7．2．2 集成DA转换器AD7524
7．2．3 DA转换器的转换精度与转换时间
7．3 AD转换器
7．3．1 AD转换的基本概念
7．3．2 并行比较型AD转换器
7．3．3 逐次逼近型AD转换器
7．3．4 双积分型AD转换器
7．3．5 AD转换器的转换精度与转换时间
7．4 多路模拟开关
7．4．1 模拟开关的功能及电路组成
7．4．2 模拟开关的各种工作模式
7．5 数据采集系统简介
7．5．1 系统的技术要求
7．5．2 系统方框图
7．5．3 电路设计
习题
附录 VHDL的基本结构与语法规则
参考文献
第1章 逻辑代数基础
1．1 导论
1．1．1 模拟信号与数字信号
1．1．2 二进制的算术运算
1．1．3 数制和码制
1．2 逻辑运算
1．2．1 基本逻辑运算
1．2．2 组合逻辑运算
1．3 公式和定理
1．3．1 常量与常量之间的关系
1．3．2 变量与常量之间的关系
1．3．3 特殊定理
1．3．4 与普通代数相似的定理
1．3．5 几个常用公式
1．4 基本规则
1．4．1 代入规则
1．4．2 对偶规则
1．4．3 反演规则
1．5 用代数法化简逻辑式
1．5．1 同一逻辑关系逻辑式形式的多样性
1．5．2 与或型逻辑式的化简步骤
1．6 *小项和*大项
1．6．1 *小项和*大项的定义
1．6．2 *小项和*大项的性质
1．6．3 与或标准型和或与标准型
1．7 卡诺图化简法
1．7．1 卡诺图
1．7．2 与项的读取和填写
1．7．3 卡诺图化简的原则
1．7．4 卡诺图化简的步骤
1．7．5 具有约束条件的逻辑函数化简
1．8 逻辑函数的变换
1．8．1 5种类型的逻辑函数
1．8．2 与或型转换为与非与非型
1．8．3 与或型转换为或与型
1．8．4 与或型转换为或非或非型
1．8．5 与或型转换为与或非型
1．9 逻辑式的*佳化
1．9．1 逻辑式*佳化的概念
1．9．2 异或门实现*佳化
1．9．3 实现*佳化的一般方法
习题
第2章 门电路
2．1 导论
2．1．1 半导体二极管的开关特性
2．1．2 半导体三极管的开关特性
2．2 分立元件门电路
2．2．1 与门
2．2．2 或门
2．2．3 非门（反相器）
2．3 集成门电路（TTL）
2．3．1 TTL与非门电路结构
2．3．2 电路的逻辑功能
2．3．3 特性曲线
2．3．4 参数与指标
2．4 其他类型TTL门
2．4．1 集电极开路门（OC门）
2．4．2 三态门
2．4．3 与或非门、或非门和异或门
2．4．4 TTL系列门标准参数
2．5 CMOS逻辑门
2．5．1 CMOS反相器
2．5．2 CMOS与非门电路
2．5．3 CMOS传输门
2．5．4 CMOS门的参数指标
2．6 数字电路的VHDL描述
2．6．1 与非门
2．6．2 或非门
2．6．3 异或门
习题
第3章 组合数字电路
3．1 导论
3．2 组合数字电路的分析
3．2．1 组合电路的分析方法
3．2．2 分析异或门
3．3 组合数字电路的设计
3．3．1 半加法器设计
3．3．2 全加器设计
3．3．3 全加器的VHDL描述
3．4 常用组合集成逻辑电路
3．4．1 集成4位超前进位全加器
3．4．2 译码器
第4章 触发器和定时器
4．1 导论
4．1．1 时序数字电路的定义
4．1．2 触发器的分类和逻辑功能
4．2 基本RS触发器
4．2．1 基本RS触发器的工作原理
4．2．2 2个稳态
4．2．3 触发翻转
4．2．4 真值表和特征方程
4．2．5 状态转换图
4．2．6 集成基本RS触发器
4．3 同步时钟RS触发器
4．3．1 同步时钟触发器引出
4．3．2 同步RS时钟触发器的结构和原理
4．3．3 同步RS时钟触发器的特征方程
4．3．4 波形及空翻现象
4．3．5 状态转换图
4．4 主从触发器
4．4．1 主从RS触发器
4．4．2 主从JK触发器
4．5 边沿触发器
4．5．1 维持阻塞D触发器的电路结构
4．5．2 维持阻塞D触发器的工作原理
4．5．3 特征表和特征方程
4．5．4 状态转换图和时序图
4．5．5 边沿集成D触发器
4．6 边沿JK触发器
4．6．1 边沿JK触发器的结构与原理
4．6．2 特征表和特征方程
4．6．3 状态转换图和时序图
4．6．4 逻辑符号
4．6．5 集成边沿JK触发器
4．7 触发器VHDL描述
4．7．1 程序设计
4．7．2 仿真验证
4．8 555定时器
4．8．1 概述
4．8．2 单稳态触发器
4．8．3 多谐振荡器
4．8．4 密特触发器
4．8．5 压控振荡器
习题
第5章 时序数字电路
5．1 导论
5．2 时序电路分析
5．2．1 同步电路分析
5．2．2 异步电路分析
5．3 同步时序数字电路的设计
5．3．1 同步计数器设计
5．3．2 时序逻辑问题设计
5．4 常用时序逻辑器件
5．4．1 寄存器和移位寄存器
5．4．2 计数器
5．4．3 用集成计数器实现任意进制计数器
5．4．4 用VHDL语言描述时序电路
习题
第6章 存储器及大规模集成电路
6．1 导论
6．2 只读存储器ROM
6．2．1 ROM的结构和工作原理
6．2．2 ROM的分类
6．2．3 ROM的应用
6．3 随机存储器
6．3．1 RAM的结构和原理
6．3．2 RAM的存储单元
6．3．3 集成RAM
6．4 可编程逻辑器件概述
6．4．1 PLD的发展
6．4．2 PLD的分类和特点
6．4．3 实现可编程的基本方法
6．5 通用阵列逻辑GAL
6．5．1 概述
6．5．2 GAL的结构
6．5．3 通用阵列逻辑GAL的编程
6．5．4 ispLSI器件的编程语言简介
6．5．5 数字小系统的设计及实现
6．6 现场可编程门阵列FPGA
6．6．1 FPGA的基本结构
6．6．2 FPGA的编程
习题
第7章 数模与模数转换器
7．1 导论
7．2 DA转换器
7．2．1 倒T型电阻解码网络DA转换器
7．2．2 集成DA转换器AD7524
7．2．3 DA转换器的转换精度与转换时间
7．3 AD转换器
7．3．1 AD转换的基本概念
7．3．2 并行比较型AD转换器
7．3．3 逐次逼近型AD转换器
7．3．4 双积分型AD转换器
7．3．5 AD转换器的转换精度与转换时间
7．4 多路模拟开关
7．4．1 模拟开关的功能及电路组成
7．4．2 模拟开关的各种工作模式
7．5 数据采集系统简介
7．5．1 系统的技术要求
7．5．2 系统方框图
7．5．3 电路设计
习题
附录 VHDL的基本结构与语法规则
参考文献
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