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Verilog HDL与CPLD/FPGA项目开发教程 版权信息
- ISBN：9787111313656
- 条形码：9787111313656 ; 978-7-111-31365-6
- 装帧：暂无
- 册数：暂无
- 重量：暂无
- 所属分类：>
Verilog HDL与CPLD/FPGA项目开发教程 本书特色
《Verilog HDL与CPLD/FPGA项目开发教程》：全国高等职业教育规划教材
Verilog HDL与CPLD/FPGA项目开发教程 目录
出版说明前言第1章 CPLD，FPGA项目开发入门1．1 CPLD／FPGA开发系统概述1．1．1 PLD的发展历程及发展趋势1．1．2 CPLD／FPGA概述1．1．3 CPLD／FPGA的结构与原理1．2 CPLD／FPGA器件识别1．2．1 CPLD／FPGA产品概况1．2．2 MAX系列产品的基本功能及编程方式1．3 CCITCPLD／FPGA实验仪使用1．3．1 实验仪结构设计1．3．2 熟悉实验仪的元器件1．3．3 解析主控芯片EPMl270T144C51．3．4 了解实验仪的外围接口及其引脚对应关系1．3．5 设计实验仪原理图1．3．6 设计Byte Blastel下载口1．4 QuartusⅡ开发环境应用1．4．1 安装QuartusIl7．2开发环境1．4.2 设计三人表决器1．5 Verilog HDL语言基础应用1．5．1 认识Verilog HDL语言基本结构1．5．2 辨别Verilog HDL语言数据类型1．5．3 识别Verilog HDL语言运算符及表达式1．6 Verilog HDL语言实例设计1．6．1 闪烁灯设计1．6．2 流水灯设计1．7 习题第2章 基于CPLD，FPGA的单元项目开发2．1 项目l设计基本逻辑门电路2．2 项目2设计译码器2．2．1 任务1设计3．8译码器2．2．2 任务2设计八段LED数码管译码电路2．3 项目3编码器和数据选择器设计2．3．1 任务l设计8-3优先编码器2．3．2 任务2设计4．1数据选择器2．4 项目4触发器设计2．4．1 任务l触发器概述2．4．2 任务2识别基本触发器2．4．3 任务3识别触发器的逻辑功能2．4．4 任务4设计时钟触发器2．4．5 任务5设计直接置位复位触发器2．4．6 任务6转换不同逻辑功能的触发器2．5 项目5全加器设计2．5．1 任务1设计一位全加器2．5．2 任务2设计串行进位加法器2．5．3 任务3设计先行进位加法器2．5．4 任务4设计加减法器2．6 项目6计数器设计2．6．1 任务1设计二进制计数器2．6．2 任务2设计七进制计数器2．6．3 任务3采用异步置数和同步清零的方法设计七进制计数器2．7 项目7乘法器设计2．7．1 任务1利用被乘数左移法设无符号乘法器2．7．2 任务2利用部分积右移法设无符号乘法器2．7．3 任务3设计带符号乘法器2．8 项目8除法器设计2．8．1 任务1利用比较法设计除法器2．8．2 任务2利用恢复余数法设计除法器2．8．3 任务3利用不恢复余数法设计除法器2．9 项目9键盘LED发光二极管应用设计2．9．1 任务1键盘LED发光二极管应用之2．9．2 任务2键盘LED发光二极管应用之二2．9．3 任务3键盘去抖动设计2．10 项目10静、动态LED发光二极管显示2．10．1 任务1静态数码管的显示设计2．10．2 任务2动态数码管显示设计2．11 项目11点阵LED显示屏及其汉字显示2．11．1 任务1点阵LED显示屏测试2．11．2 任务2汉字显示2．12 项目12蜂鸣器应用设计2．12．1 任务1发出报警声2．12．2 任务2设计简易数字电子琴2．12．3 任务3设计“梁祝”音乐片段2．13 项目13LCD液晶显示系统设计2．13．1 任务1了解液晶显示的基础知识2．13．2 任务2液晶屏滚动显示“www．ccit．is．cn”字符2．14 习题第3章 基于CPLD，FPGA的综合项目开发3．1 项目1基于VerilogHDL的数字时钟设计与实现3．1．1 任务1任务提出及设计分析3．1．2 任务2分频模块设计3．1．3 任务3校时模块设计3．1．4 任务4计时处理模块设计3．1．5 任务5报时模块设计3．1．6 任务6显示模块设计3．1．7 任务7顶层模块设计3．1．8 任务8下载调试运行3．2 项目2基于VerilogHDL的交通信号灯模拟控制设计3．2．1 任务1任务提出及设计分析3．2．2 任务2初始化模块设计3．2．3 任务3分频模块设计3．2．4 任务4控制A方向4盏灯亮火模块设计3．2．5 任务5控制B方向4盏灯亮灭模块设计3．2．6 任务6A、B方向各种灯剩余时间的显示模块设计3．2．7 任务7顶层文件设计3．2．8 任务8下载调试运行3．3 项目3UART异步串行通信设计3．3．1 任务l串行通信基础知识3．3．2 任务2串行发送模块设计3．3．3 任务3串行接收模块设计3．4 项目4基于VerilogHDL的四路数字式竞赛抢答器设计3．4．1 任务1任务提出及设计分析3．4．2 任务2信号锁存电路设计3．4．3 任务3计分电路设计3．4．4 任务4数码管显示电路设计3．4．5 任务5顶层文件设计3．4．6 任务6下载调试运行3．5 习题附录附录A Verilog HDL关键字附录B Quartusl L7．2支持的Verilog HDL数据类型和语句附录C 基于Verilog HDL的CPLD／FPGA设计常见问题解析附录D 高级语言的串行通信编程参考文献
展开全部
Verilog HDL与CPLD/FPGA项目开发教程 节选
《Verilog HDL与CPLD/FPGA项目开发教程》以Altera公司的MAXII系列EPMl270T144C：5N为蓝本阐述了基于CPLD／FPGA的数字系统设计方法，重点放在工程实践能力和Verilog HDL硬件描述语言的编程开发能力方面。《Verilog HDL与CPLD/FPGA项目开发教程》按照基于工作过程的以“项目”为载体的教学模式的思路进行编写，“项目”的选取以直观、生动、有趣、实用为原则，并遵循由易到难、由简单到综合的学习规律。全书共3章，第1章主要介绍CPLD／FPGA项目开发入门，包括CPLD／FPGA开发系统概述、0uartusⅡ开发环境的使用、Verilog HDL硬件描述语言编程基础；第2章以13个单元项目为载体来介绍组合逻辑电路设计、时序逻辑电路设计和数字系统设计（如键盘、数码管、液晶、点阵屏、音乐等外围接口的驱动）；第3章以电子时钟、交通信号灯控制、串行通信、数字式竞赛抢答器4个综合项目为载体，介绍用Verilog HDL硬件描述语言进行综合项目开发的一般步骤，使读者在实践中锻炼编程、调试和创新能力，形成良好的编程风格。附录中给出了数字系统设计中的常见问题解析。《Verilog HDL与CPLD/FPGA项目开发教程》可作为高职高专电子工程、计算机、微电子、自动控制等相关专业电子设计自动化（Electronic Design Automation，EDA）课程的教材，也可作为EDA初学者或工程技术人员的参考资料。
Verilog HDL与CPLD/FPGA项目开发教程 相关资料
插图：随着电子设计自动化（EDA）技术的不断发展，其含义也在不断发生变化，早期的电子设计自动化多指类似Protel电路版图的设计自动化概念，这种概念仅限于电路元器件与元器件之问（即芯片外）设计自动化，而由于微电子技术的不断发展，当今的EDA技术则更多的是指可编程逻辑器件的设计技术，即芯片内的电路设计自动化。也就是说，开发人员完全可以通过自己的电路设计来定制其芯片内部的电路功能，使之成为设计者自己的专用集成电路（ASIC）芯片。这就是我们今天所说的的EDA技术——用户PLD（可编程逻辑器件）技术。它的应用无处不在，从简单的逻辑电路、时序电路设计到复杂的数字系统设计，从通信领域（软件无线电）、数字信号处理（DSP）领域，到嵌入式／片上系统（SOC）及各种IP内核等诸多领域。如果说原来的Tango（Protel）问世在电子设计领域是一次革命的话，那么，今天的CPLD／FPGA技术称得上是电子设计领域的第二次革命。随着可编程器件PLD技术的不断发展和崛起，其功能之卓越和先进已经令当今的电子工程师们赞叹不已，除了它设计灵活、仿真调试方便、体积小、容量大、I／O口丰富、成本低廉、易编程和加密等优点外，更突出的特点是其芯片的在系统可编程技术。也就是说，它不但具有可编程和可再反复编程的能力，而且只要把器件插在用户自己设计的目标系统内或线路板上，就可以重新构造其设计逻辑而对器件进行编程或者反复编程，这种技术被称为在系统可编程技术，简称ISP技术。由于ISP技术的应用，打破了产品开发时必须先编程后装配的惯例，而可以做到先装配后编程，成为产品后还可以在系统内反复编程和修改。ISP技术使得系统内硬件的功能像软件一样被编程配置，使系统的升级和维护变得更容易和方便。可以说，可编程器件真正做到了硬件的“软件化”自动设计。
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